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VHDL基于MIPS指令集的32位CPU設計(含源碼)-專業指導文檔類資源

robot  在  2019-11-23 02:31:42  上傳  10.53 MB VHDL MIPS CPU


本文的主體部分首先詳細描述了處理器各個獨立功能模塊的設計,為后續的整體設計實現提供邏輯功能支持。隨后按照單周期、多周期、流水線的順序,循序漸進的圍繞著指令執行過程中需經歷的五個階段,詳細描述了3個版本的處理器中各階段的邏輯設計。在完成了各個版本的CPU的整體邏輯設計后,通過Quartus II時序仿真軟件在所設計的CPU上運行了測試程序,測試輸出波形表明了處理器邏輯設計的正確性。
附錄包含了三個版本處理器實現的源碼。


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